简单列一下六月份 JSSC 的几篇论文

A 2.2 GHz −242 dB-FOM 4.2 mW ADC-PLL Using Digital Sub-Sampling Architecture

ADC 结构提高 phase digitalization的 resolution 从而改善相位噪声

A 4 Bit Continuous-Time ΣΔ Modulator With Fully Digital Quantization Noise Reduction Algorithm Employing a 7 Bit Quantizer

对 MASH 结构的CT-SDM, 将量化器的低三位用作quantization noise reduction

A SAR ADC With a MOSCAP-DAC

主要是基于 charge-sharing ADC 的结构

A 2.4 mA Quiescent Current, 1 W Output Power Class-D Audio Amplifier With Feed-Forward PWM-Intermodulated- Distortion Reduction

利用 replica circuit 方式的前馈结构来改善 pwm-intermodulated-distortion

简单列一下五月份的 JSSC 的两篇论文

An 11b 450 MS/s Three-Way Time-Interleaved Subranging Pipelined-SAR ADC in 65 nm CMOS

结合 Subranging Pipeline SAR 的结构，以及 offset calibration 和 error decision correction 的方法

A Continuous-Time Delta-Sigma Modulator Using ELD-Compensation-Embedded SAB and DWA-Inherent Time-Domain Quantizer

利用 single-amplifier-biquad 结构的三阶CT-SDM 减少所需的放大器，同时亦包含 excess-loop-delay 的补偿

简单的记录一下四月份 JSSC 的两篇论文

A 10/20/30/40 MHz Feedforward FIR DAC Continuous-Time ΔΣ ADC With Robust Blocker Performance for Radio Receivers

连续时间 SDM，关于 clock jitter 和 FIR DAC 的问题

A 3–10 fJ/conv-step Error-Shaping Alias-Free Continuous-Time ADC

类似 integrator + delta encoder 的结构